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150. 模块八 6.1 时序逻辑电路分析(4) - 1
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数字电路与系统
大学课程 / 电子通讯
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1
模块一 课程介绍 - 1
08:57
2
模块一 课程介绍 - 3
08:56
3
模块一 概述(1)
05:45
4
模块一 概述(2) - 1
10:11
5
模块一 概述(2) - 3
10:09
6
模块一 概述(3)
07:10
7
模块一 概述(4)
04:18
8
模块一 概述(5) - 1
08:12
9
模块一 概述(5) - 3
08:13
10
模块一 概述(6)
06:47
11
模块二 1.1 数制与数制之间的转换(1) - 1
09:06
12
模块二 1.1 数制与数制之间的转换(1) - 3
09:05
13
模块二 1.1 数制与数制之间的转换(2) - 1
07:42
14
模块二 1.1 数制与数制之间的转换(2) - 3
07:43
15
模块二 1.1 数制与数制之间的转换(3) - 1
08:01
16
模块二 1.1 数制与数制之间的转换(3) - 3
08:00
17
模块二 1.1 数制与数制之间的转换(4) - 1
09:50
18
模块二 1.1 数制与数制之间的转换(4) - 3
09:51
19
模块二 1.2 码制和计算机的数的表示方法(1) - 1
09:07
20
模块二 1.2 码制和计算机的数的表示方法(1) - 3
09:07
21
模块二 1.2 码制和计算机的数的表示方法(2)
07:58
22
模块二 1.2 码制和计算机的数的表示方法(3) - 1
06:55
23
模块二 1.2 码制和计算机的数的表示方法(3) - 3
06:53
24
模块二 1.2 码制和计算机的数的表示方法(4) - 1
09:01
25
模块二 1.2 码制和计算机的数的表示方法(4) - 3
09:06
26
模块二 1.2 码制和计算机的数的表示方法(5)
06:28
27
模块二 1.3 计算机中的非数值数据(1)
07:06
28
模块二 1.3 计算机中的非数值数据(2) - 1
06:27
29
模块二 1.3 计算机中的非数值数据(2) - 3
06:27
30
模块二 1.3 计算机中的非数值数据(3)
08:46
31
模块三 2.1 逻辑函数基本运算与定律(1) - 1
12:29
32
模块三 2.1 逻辑函数基本运算与定律(1) - 3
12:28
33
模块三 2.1 逻辑函数基本运算与定律(2) - 1
06:43
34
模块三 2.1 逻辑函数基本运算与定律(2) - 3
06:47
35
模块三 2.1 逻辑函数基本运算与定律(3)
05:02
36
模块三 2.1 逻辑函数基本运算与定律(4)
06:34
37
模块三 2.1 逻辑函数基本运算与定律(5) - 1
05:35
38
模块三 2.1 逻辑函数基本运算与定律(5) - 3
05:39
39
模块三 2.1 逻辑函数基本运算与定律(6)
07:18
40
模块三 2.2 逻辑函数及其描述方法(1)
04:22
41
模块三 2.2 逻辑函数及其描述方法(2)
06:11
42
模块三 2.2 逻辑函数及其描述方法(3)
05:46
43
模块三 2.2 逻辑函数及其描述方法(4) - 1
10:37
44
模块三 2.2 逻辑函数及其描述方法(4) - 3
10:42
45
模块三 2.2 逻辑函数及其描述方法(5) - 1
09:48
46
模块三 2.2 逻辑函数及其描述方法(5) - 3
09:51
47
模块三 2.3 逻辑函数的化简(1) - 1
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48
模块三 2.3 逻辑函数的化简(1) - 3
06:37
49
模块三 2.3 逻辑函数的化简(2) - 1
06:19
50
模块三 2.3 逻辑函数的化简(2) - 3
06:23
51
模块三 2.3 逻辑函数的化简(3) - 1
08:51
52
模块三 2.3 逻辑函数的化简(3) - 3
08:51
53
模块三 2.3 逻辑函数的化简(4) - 1
10:00
54
模块三 2.3 逻辑函数的化简(4) - 3
10:05
55
模块四 3.1 组合逻辑电路的分析与最少化设计(1) - 1
09:58
56
模块四 3.1 组合逻辑电路的分析与最少化设计(1) - 3
09:55
57
模块四 3.1 组合逻辑电路的分析与最少化设计(2)
09:56
58
模块四 3.1 组合逻辑电路的分析与最少化设计(3) - 1
09:15
59
模块四 3.1 组合逻辑电路的分析与最少化设计(3) - 3
09:17
60
模块四 3.1 组合逻辑电路的分析与最少化设计(4)
08:01
61
模块四 3.2 组合逻辑电路的竞争与冒险(1) - 1
09:19
62
模块四 3.2 组合逻辑电路的竞争与冒险(1) - 3
09:23
63
模块四 3.2 组合逻辑电路的竞争与冒险(2) - 1
08:58
64
模块四 3.2 组合逻辑电路的竞争与冒险(2) - 3
09:00
65
模块四 3.2 组合逻辑电路的竞争与冒险(3) - 1
07:17
66
模块四 3.2 组合逻辑电路的竞争与冒险(3) - 3
07:21
67
模块四 3.2 组合逻辑电路的竞争与冒险(4) - 1
11:20
68
模块四 3.2 组合逻辑电路的竞争与冒险(4) - 3
11:26
69
模块四 3.2 组合逻辑电路的竞争与冒险(5)
07:50
70
模块四 实验教学(一)(1)
01:08
71
模块四 实验教学(一)(2)
01:58
72
模块四 实验教学(一)(3)
02:24
73
模块四 实验教学(一)(4)
02:05
74
模块五 4.1 编码器 译码器(1) - 1
07:43
75
模块五 4.1 编码器 译码器(1) - 3
07:41
76
模块五 4.1 编码器 译码器(2) - 1
05:57
77
模块五 4.1 编码器 译码器(2) - 3
06:02
78
模块五 4.1 编码器 译码器(3) - 1
12:30
79
模块五 4.1 编码器 译码器(3) - 3
12:31
80
模块五 4.1 编码器 译码器(4) - 1
07:30
81
模块五 4.1 编码器 译码器(4) - 3
07:29
82
模块五 4.1 编码器 译码器(5) - 1
05:54
83
模块五 4.1 编码器 译码器(5) - 3
05:58
84
模块五 4.1 编码器 译码器(6)
09:50
85
模块五 4.1 编码器 译码器(7) - 1
09:08
86
模块五 4.1 编码器 译码器(7) - 3
09:14
87
模块五 4.2 数据选择器 分配器(1) - 1
07:59
88
模块五 4.2 数据选择器 分配器(1) - 3
08:02
89
模块五 4.2 数据选择器 分配器(2) - 1
05:10
90
模块五 4.2 数据选择器 分配器(2) - 3
05:07
91
模块五 4.2 数据选择器 分配器(3) - 1
12:23
92
模块五 4.2 数据选择器 分配器(3) - 3
12:28
93
模块五 4.2 数据选择器 分配器(4) - 1
08:21
94
模块五 4.2 数据选择器 分配器(4) - 3
08:18
95
模块六 4.3 比较器 校验电路(1) - 1
07:00
96
模块六 4.3 比较器 校验电路(1) - 3
07:01
97
模块六 4.3 比较器 校验电路(2) - 1
07:41
98
模块六 4.3 比较器 校验电路(2) - 3
07:42
99
模块六 4.3 比较器 校验电路(3) - 1
11:52
100
模块六 4.3 比较器 校验电路(3) - 3
11:49
101
模块六 4.4 算术运算电路及ALU(1) - 1
06:00
102
模块六 4.4 算术运算电路及ALU(1) - 3
06:02
103
模块六 4.4 算术运算电路及ALU(2) - 1
05:26
104
模块六 4.4 算术运算电路及ALU(2) - 3
05:31
105
模块六 4.4 算术运算电路及ALU(3) - 1
09:57
106
模块六 4.4 算术运算电路及ALU(3) - 3
09:55
107
模块六 4.4 算术运算电路及ALU(4) - 1
08:08
108
模块六 4.4 算术运算电路及ALU(4) - 3
08:12
109
模块六 4.4 算术运算电路及ALU(5) - 1
12:07
110
模块六 4.4 算术运算电路及ALU(5) - 3
12:04
111
模块六 4.4 算术运算电路及ALU(6)
03:54
112
模块六 关键知识点讲解(一)(1)
07:20
113
模块六 关键知识点讲解(一)(2)
06:33
114
模块六 关键知识点讲解(一)(3)
06:39
115
模块六 关键知识点讲解(一)(4)
03:43
116
模块六 关键知识点讲解(一)(5)
05:06
117
模块六 关键知识点讲解(一)(6)
04:40
118
模块六 关键知识点讲解(一)(7)
06:30
119
模块六 关键知识点讲解(一)(8)
09:38
120
模块六 关键知识点讲解(一)(9)
06:28
121
模块六 关键知识点讲解(一)(10) - 1
06:49
122
模块六 关键知识点讲解(一)(10) - 3
06:47
123
模块七 触发器(1) - 1
10:00
124
模块七 触发器(1) - 3
10:06
125
模块七 触发器(2) - 1
07:16
126
模块七 触发器(2) - 3
07:20
127
模块七 触发器(3) - 1
09:21
128
模块七 触发器(3) - 3
09:26
129
模块七 触发器(4)
07:45
130
模块七 触发器(5) - 1
06:11
131
模块七 触发器(5) - 3
06:16
132
模块七 触发器(6)
07:16
133
模块七 触发器(7) - 1
10:00
134
模块七 触发器(7) - 3
09:57
135
模块七 触发器(8) - 1
07:35
136
模块七 触发器(8) - 3
07:37
137
模块七 触发器(9) - 1
07:26
138
模块七 触发器(9) - 3
07:25
139
模块七 触发器(10)
04:25
140
模块七 触发器(11) - 1
07:44
141
模块七 触发器(11) - 3
07:46
142
模块七 触发器(12)
09:59
143
模块七 触发器(13)
09:55
144
模块八 6.1 时序逻辑电路分析(1) - 1
06:29
145
模块八 6.1 时序逻辑电路分析(1) - 3
06:30
146
模块八 6.1 时序逻辑电路分析(2) - 1
11:04
147
模块八 6.1 时序逻辑电路分析(2) - 3
11:07
148
模块八 6.1 时序逻辑电路分析(3) - 1
09:46
149
模块八 6.1 时序逻辑电路分析(3) - 3
09:43
150
模块八 6.1 时序逻辑电路分析(4) - 1
07:50
151
模块八 6.1 时序逻辑电路分析(4) - 3
07:47
152
模块八 6.1 时序逻辑电路分析(5) - 1
11:38
153
模块八 6.1 时序逻辑电路分析(5) - 3
11:43
154
模块八 6.1 时序逻辑电路分析(6) - 1
12:06
155
模块八 6.1 时序逻辑电路分析(6) - 3
12:13
156
模块九 6.2 时序逻辑电路设计(1) - 1
10:47
157
模块九 6.2 时序逻辑电路设计(1) - 3
10:47
158
模块九 6.2 时序逻辑电路设计(2) - 1
08:26
159
模块九 6.2 时序逻辑电路设计(2) - 3
08:31
160
模块九 6.2 时序逻辑电路设计(3) - 1
08:30
161
模块九 6.2 时序逻辑电路设计(3) - 3
08:36
162
模块九 6.2 时序逻辑电路设计(4)
02:44
163
模块九 6.2 时序逻辑电路设计(5) - 1
08:45
164
模块九 6.2 时序逻辑电路设计(5) - 3
08:48
165
模块九 6.2 时序逻辑电路设计(6) - 1
07:43
166
模块九 6.2 时序逻辑电路设计(6) - 3
07:49
167
模块九 6.2 时序逻辑电路设计(7)
07:33
168
模块十 7.1 寄存器和移位寄存器(1) - 1
06:40
169
模块十 7.1 寄存器和移位寄存器(1) - 3
06:41
170
模块十 7.1 寄存器和移位寄存器(2) - 1
10:47
171
模块十 7.1 寄存器和移位寄存器(2) - 3
10:52
172
模块十 7.1 寄存器和移位寄存器(3)
02:20
173
模块十 7.1 寄存器和移位寄存器(4) - 1
11:24
174
模块十 7.1 寄存器和移位寄存器(4) - 3
11:30
175
模块十 7.2 计数器(1) - 1
07:41
176
模块十 7.2 计数器(1) - 3
07:38
177
模块十 7.2 计数器(2) - 1
08:35
178
模块十 7.2 计数器(2) - 3
08:40
179
模块十 7.2 计数器(3) - 1
09:19
180
模块十 7.2 计数器(3) - 3
09:18
181
模块十 7.2 计数器(4)
06:43
182
模块十 7.2 计数器(5) - 1
05:12
183
模块十 7.2 计数器(5) - 3
05:14
184
模块十 7.2 计数器(6) - 1
11:10
185
模块十 7.2 计数器(6) - 3
11:13
186
模块十 7.2 计数器(7) - 1
11:53
187
模块十 7.2 计数器(7) - 3
11:53
188
模块十 7.2 计数器(8)
05:54
189
模块十 7.2 计数器(9) - 1
05:07
190
模块十 7.2 计数器(9) - 3
05:13
191
模块十一 7.3 序列信号发生器(1)
05:12
192
模块十一 7.3 序列信号发生器(2) - 1
11:57
193
模块十一 7.3 序列信号发生器(2) - 3
12:01
194
模块十一 7.3 序列信号发生器(3) - 1
09:11
195
模块十一 7.3 序列信号发生器(3) - 3
09:09
196
模块十一 7.3 序列信号发生器(4) - 1
05:12
197
模块十一 7.3 序列信号发生器(4) - 3
05:10
198
模块十二 8.1 半导体存储器概念(1) - 1
12:15
199
模块十二 8.1 半导体存储器概念(1) - 3
12:17
200
模块十二 8.1 半导体存储器概念(2) - 1
13:00
201
模块十二 8.1 半导体存储器概念(2) - 3
13:07
202
模块十二 8.1 半导体存储器概念(3)
04:43
203
模块十二 8.2 随机存储器RAM(1) - 1
06:37
204
模块十二 8.2 随机存储器RAM(1) - 3
06:34
205
模块十二 8.2 随机存储器RAM(2) - 1
06:26
206
模块十二 8.2 随机存储器RAM(2) - 3
06:32
207
模块十二 8.2 随机存储器RAM(3) - 1
06:47
208
模块十二 8.2 随机存储器RAM(3) - 3
06:49
209
模块十二 8.2 随机存储器RAM(4) - 1
09:41
210
模块十二 8.2 随机存储器RAM(4) - 3
09:43
211
模块十二 8.2 随机存储器RAM(5) - 1
05:47
212
模块十二 8.2 随机存储器RAM(5) - 3
05:49
213
模块十二 8.3 只读存储器ROM - 1
10:13
214
模块十二 8.3 只读存储器ROM - 3
10:10
215
模块十二 8.4 存储器容量的扩展(1) - 1
06:36
216
模块十二 8.4 存储器容量的扩展(1) - 3
06:38
217
模块十二 8.4 存储器容量的扩展(2)
05:35
218
模块十二 8.4 存储器容量的扩展(3) - 1
08:30
219
模块十二 8.4 存储器容量的扩展(3) - 3
08:34
220
模块十三 9.1 可编程逻辑器件的结构与表示方法 - 1
06:31
221
模块十三 9.1 可编程逻辑器件的结构与表示方法 - 3
06:30
222
模块十三 9.2 PLA与PAL(1)
01:50
223
模块十三 9.2 PLA与PAL(2) - 1
11:12
224
模块十三 9.2 PLA与PAL(2) - 3
11:19
225
模块十三 9.2 PLA与PAL(3)
09:02
226
模块十三 9.3 GAL - 1
05:18
227
模块十三 9.3 GAL - 3
05:18
228
模块十三 9.4 CPLD
05:41
229
模块十三 9.5 FPGA
08:16
230
模块十四 10.1 概述(1) - 1
09:30
231
模块十四 10.1 概述(1) - 3
09:34
232
模块十四 10.1 概述(2) - 1
06:09
233
模块十四 10.1 概述(2) - 3
06:07
234
模块十四 10.2 数模转换(1) - 1
06:34
235
模块十四 10.2 数模转换(1) - 3
06:37
236
模块十四 10.2 数模转换(2) - 1
06:40
237
模块十四 10.2 数模转换(2) - 3
06:39
238
模块十四 10.2 数模转换(3)
07:00
239
模块十四 10.2 数模转换(4)
07:46
240
模块十四 10.2 数模转换(5)
08:02
241
模块十四 10.2 数模转换(6) - 1
10:45
242
模块十四 10.2 数模转换(6) - 3
10:47
243
模块十四 10.3 模数转换(1) - 1
10:58
244
模块十四 10.3 模数转换(1) - 3
10:59
245
模块十四 10.3 模数转换(2)
07:59
246
模块十四 10.3 模数转换(3) - 1
11:50
247
模块十四 10.3 模数转换(3) - 3
11:49
248
模块十四 10.3 模数转换(4) - 1
10:10
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